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Arquitetura e Organização de Computadores

Por:   •  3/12/2018  •  Projeto de pesquisa  •  894 Palavras (4 Páginas)  •  170 Visualizações

Página 1 de 4

[pic 1]

Centro Universitário de Rio Preto

Trabalho #1: LATCH - MAR

Aluno: Marcos Libanori Sanches Junior   –   Código: 20144512

Turma: 52.331-0

Disciplina: Arquitetura e Organização de Computadores

Curso: Engenharia da Computação

Professor: M. Sc. José A. A. Viana.

São José do Rio Preto, 14 de Maio de 2017.

Sumário

1.        Latch D 1Bit        3

a)        Modelo Lógico        3

b)        Tabela Verdade        3

c)        Circuito Lógico // Aberto        3

d)        Circuito Lógico // Macro        4

2.        Latch D 4Bits        4

a)        Modelo Lógico        4

b)        Tabela Verdade        4

c)        Circuito Lógico // Aberto        5

d)        Circuito Lógico // Macro        5

3.        Flip-Flop 1 BIT        6

a)        Modelo Lógico        6

b)        Tabela Verdade        6

c)        Circuito Lógico // Aberto        6

d)        Circuito Lógico // Macro        6

4.        Flip-Flop 4Bits        7

a)        Modelo Lógico        7

b)        Tabela Verdade        7

c)        Circuito Lógico // Aberto        7

d)        Circuito Lógico // Macro        8

5.        MAR 4 Bits        8

a)        Modelo Lógico        8

b)        Tabela Verdade        8

c)        Circuito Lógico // Aberto        9

d)        Circuito Lógico // Macro        9

  1. Latch D 1Bit

  1. Modelo Lógico


[pic 2]

Figura 1 –Latch D 1BIT // Modelo Lógico

  1. Tabela Verdade

E

D

Q

0

0

HOLD

0

1

HOLD

1

0

RESET

1

1

SET

Tabela 1 - Tabela Verdade Latch D 1Bit

  1. Circuito Lógico // Aberto

[pic 3]

Figura 2 - Circuito Lógico Buffer Latch D 1Bit // Aberto

  1. Circuito Lógico // Macro

[pic 4]

Figura 3 - Circuito Lógico Buffer tri-state 4Bits // Macro

  1. Latch D 4Bits

  1. Modelo Lógico


[pic 5]

Figura 4 - Latch D 4BITS - Modelo lógico

  1. Tabela Verdade

E

BUS Q

0

HOLD

1

BUS D


Tabela 2 - Tabela Verdade Latch D 4BITS

  1. Circuito Lógico // Aberto

[pic 6]

Figura 5 - Circuito Lógico Latch D 4BITS // Aberto

  1. Circuito Lógico // Macro

[pic 7]

Figura 6 - Circuito Lógico Latch D 4BITS // Macro

  1. Flip-Flop 1 BIT

  1. Modelo Lógico


[pic 8]

Figura 7 – Flip-Flop 1 Bit  - Modelo lógico

  1. Tabela Verdade

CP

D

Q

[pic 9]

0

SET

[pic 10]

1

RESET

Tabela 3 - Tabela Verdade Flip-Flop 1 Bit  

  1. Circuito Lógico // Aberto

[pic 11]

Figura 8 - Circuito Lógico Flip-Flop 1 Bit  // Aberto

  1. Circuito Lógico // Macro

[pic 12]

Figura 9 - Circuito Lógico Flip-Flop 1 Bit // Macro

  1. Flip-Flop 4Bits

  1. Modelo Lógico


[pic 13]

Figura 10 - Flip-Flop 4 BITS - Modelo lógico

  1. Tabela Verdade

CP

BUS Q

[pic 14]

BUS D

Figura 11 - Tabela Verdade Flip-Flop 4 BITS

  1. Circuito Lógico // Aberto

[pic 15]

Figura 12 - Circuito Lógico Flip-Flop 4 BITS // Aberto

...

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